Retos en el diseño de un generador caótico en tecnología CMOS submicrónica

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Título: Retos en el diseño de un generador caótico en tecnología CMOS submicrónica
Autor/es: Aznar, Francisco | Sánchez-Azqueta, Carlos | Gimeno, Cecilia
Palabras clave: Circuito de Chua | Comunicación segura | Generador caótico | Tecnología CMOS | Chaotic generator | Chua’s circuit | CMOS technology | Secure communication
Área/s de conocimiento: Ciencia de la Computación e Inteligencia Artificial
Fecha de publicación: sep-2014
Editor: Universidad de Alicante
Cita bibliográfica: Actas de la XIII Reunión Española sobre Criptología y Seguridad de la Información : celebrado del 5 al 8 de septiembre 2014, Alicante, pp. 29-33
Resumen: En este artículo se exponen los retos para llevar a cabo el diseño de un generador caótico, basado en el circuito de Chua, en tecnología CMOS submicrónica. El diseño analógico del generador caótico se complementa con un control digital, que proporciona programabilidad para definir distintos estados (claves) que aumenten la seguridad del cifrado. Además, se analizan distintas variables (temperatura, mismatching...) que pueden afectar a la sincronización de dos sistemas idealmente idénticos, impidiendo el descifrado de la información transmitida.
Patrocinador/es: Los autores agradecen la ayuda concedida por el Centro Universitario de la Defensa (2013-12) para iniciar esta línea de investigación, así como la colaboración del Grupo de Diseño Electrónico mediante el proyecto del Plan Nacional de I+D+i TEC2011-23211.
URI: http://hdl.handle.net/10045/40391
ISBN: 978-84-9717-323-0
Idioma: spa
Tipo: info:eu-repo/semantics/conferenceObject
Revisión científica: si
Aparece en las colecciones:Congresos - RECSI 2014 - Comunicaciones

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